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maxplus2是什么
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是Altera公司推出的的第三代PLD开发系统(Altera第四代PLD开发系统被称为：Quartus，主要用于设计6万-100万门的大规模CPLD/FPGA).使用MAX+PLUSII的设计者不需精通器件内部的复杂结构。设计者可以用自己熟悉的设计工具（如原理图输入或硬件描述语言）建立设计，MAX+PLUSII把这些设计转自动换成最终所需的格式。其设计速度非常快。对于一般几千门的电路设计，使用MAX+PLUSII，从设计输入到器件编程完毕，用户拿到设计好的逻辑电路，大约只需几小时。设计处理一般在数分钟内内完成。特别是在原理图输入等方面，Maxplus2被公认为是最易使用，人机界面最友善的PLD开发软件，特别适合初学者使用。
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maxplus2和quartus2都是Alter开发的软件。很多操作的基本相同。maxplus2是老期版本，从2000年左右就没有更新了。因此新的器件都不支持了。quartus2是后来出的版本，不断更新，支持Alera最新的CPLD和FPGA器件。
简单的说就是一个设计IC的软件，以设计属于自己的IC芯片。Altera公司的
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> FPGA设计开发软件Quartus II的使用技巧之： 创建工程设计文件
FPGA设计开发软件Quartus II的使用技巧之： 创建工程设计文件
5.5创建工程设计文件5.5.1创建工程软件将工程信息存储在工程配置文件中，如表5.1所示。它包含有关工程的所有信息，包括设计文件、波形文件、SignalTap&II文件、内存初始化文件以及构成工程的、和软件构建设置。本文引用地址：表5.1 QuartusII工程文件文件类型说明QuartusIIProjectFile（.qpf）指定用来建立和修订工程的QuartusII软件版本QuartusIISettingFile（.qsf）包括AssignmentEditor、FloorplanEditor、&Setting&对话框（&Assignment&菜单），Tcl脚本或者QuartusII可执行文件产生的所有修订范围或者独立的分配。工程中每个修订有一个QSFQuartusIIWorkspaceFile（.qws）包含用户偏好和其他信息，例如窗口信息、窗口打开文件及其位置QuartusIIDefaultSettingsFile（.qdf）位于\QuartusIIsystemdirectory&\bin目录下，包括所有全局默认工程设置。QSF中的设置将替代这些设置可以使用&File&菜单中的&NewProjectWizard&来创建工程。使用&NewProjectWizard&可以为工程指定工作目录、分配工程名称以及指定最高层设计实体的名称，还可以指定工程中使用的设计文件、其他源文件、用户库、EDA工具以及目标器件。建立工程后，可以使用&Assignments&菜单的&Settings&对话框中的&Add/Remove&页，在工程中添加和删除设计和其他文件。在执行QuartusIIAnalysisSynthesis期间，QuartusII软件将按&Add/Remove&页中显示的顺序处理文件。如图5.5～图5.10所示为使用NewProjectWizard来创建工程的流程。
图5.5新建工程向导 图5.6选择工程路径、名、顶层模块名
图5.7添加设计文件图5.8选择目标器件（型号）
图5.9选择EDA综合、仿真、时序分析工具图5.10工程信息汇总如果想通过QuartusII来查看和编辑MAX+PLUSII工程，还可以使用&File&菜单的&ConvertMAX+PLUSIIProject&命令，将MAX+PLUSII分配与配置文件（.acf）转换为QuartusII工程可编辑的文件，如图5.11所示。图5.11&ConvertMAX+PLUSIIProject&对话框5.5.2添加设计文件1．添加设计文件方式QuartusII软件支持如下几种设计输入方式。&在BlockEditor中建立设计。&在TextEditor中通过AHDL、VerilogHDL或VHDL设计语言建立设计。&采用EDA设计输入和综合工具生成的EDIF输入文件（.edf）或VQM文件（.vqm）建立设计。2．支持的设计文件类型如表5.2所示为QuartusII软件支持的设计文件类型。表5.2 QuartusII设计文件类型类型描述扩展名原理图设计文件使用QuartusIIBlockEditor建立的原理图设计文件.bdfEDIF输入文件使用任何标准EDIF网表编写程序生成的2000版EDIF网表文件.edf.edif图形设计文件使用MAX+PLUSIIGraphicEditor建立的原理图设计文件.gdf文本设计文件以Altera硬件描述语言（HDL）编写的设计文件.tdfVerilog设计文件包含使用VerilogHDL定义的设计逻辑的设计文件.v.vlg.verilogVHDL设计文件包含使用VHDL定义的设计逻辑的设计文件.vh.vhd.vhdlVQM设计文件通过SynplicitySynplify软件或QuartusII软件生成的VerilogHDL格式网表文件.vqm如图5.12是QuartusII软件所支持的设备设计文件类型。如图5.13所示是QuartusII软件所支持的软件文件类型。
图5.12&DeviceDesignFiles&对话框图5.13&SoftwareFiles&对话框如图5.14所示是QuartusII软件所支持的其他文件类型。图5.14其他文件类型3．使用Blockeditor设计文件BlockEditor用于以原理图和流程图的形式输入和编辑图形设计信息。QuartusIIBlockEditor可以读取并编辑原理图设计文件和MAX+PLUSII图形设计文件。也可以在QuartusII软件中打开图形设计文件并将其另存为原理图设计文件。BlockEditor将每个流程图、原理图或符号代表的设计逻辑融合到工程中。这些图形设计文件包含块和符号，这些块和符号代表设计中的逻辑。可以使用原理图设计文件的块建立新设计文件，或在修改块和符号时更新设计文件，也可以在原理图设计文件的基础上生成块符号文件（.bsf）、AHDL包含文件（inc）和HDL文件。还可以在编译之前分析原理图设计文件是否出错。BlockEditor还提供有助于在原理图设计文件中连接块和基本单元（包括总线和节点连接以及信号名称映射）的一组工具。可以更改BlockEditor的显示选项，例如根据偏好更改导向线和网格间距、橡皮带式生成线、颜色和屏幕元素、缩放以及不同的块属性等。BlockEditor具备以下的功能。&插入块和基本单元符号。流程图使用称为块的矩形符号代表设计实体以及相应的已分配信号，在从上到下的设计中很有用。块是用代表相应信号流程的管道连接起来的。可以只用流程图进行设计，也可以将流程图与图形单元相结合进行设计。从块或原理图文件建立文件。在层次化设计中，可以在使用BlockEditor中的Create/Update命令，利用原理图文件中的块建立其他类型的设计文件，还可以从原理图文件本身建立这些设计文件。4．使用TextEditor设计文件TextEditor是一个灵活的工具，用于以AHDL、VHDL和VerilogHDL语言以及Tcl脚本语言输入文本型设计。还可以使用TextEditor输入、编辑和查看其他ASCII文本文件，包括为QuartusII软件或由QuartusII软件建立的那些文本文件。5．使用SymbolEditor设计文件SymbolEditor用于查看和编辑代表宏功能、宏功能模块、基本单元或设计文件的预定义符号。每个SymbolEditor文件代表一个符号。对于每个符号文件，均可以从包含Altera宏功能模块和LPM函数的库中选择。可以自定义这些块符号文件，然后将这些符号添加到使用BlockEditor建立的原理图中。SymbolEditor读取并编辑块符号文件和MAX+PLUSII符号文件（.sym），并将它们转存为块符号文件。6．使用VerilogHDL、VHDL与AHDL设计文件可以使用TextEditor或其他文本编辑器建立文本设计文件、Verilog设计文件和VHDL设计文件，并在分级设计中将这些文件与其他类型的设计文件相结合。Verilog设计文件和VHDL设计文件可以包含由QuartusII支持的构造的任意组合。它们还可以包含Altera提供的逻辑函数，包括基本单元和宏功能模块以及用户自定义的逻辑函数。在TextEditor中，使用Create/Update命令（&File&菜单）从当前的VerilogHDL或VHDL设计文件建立块符号文件，然后将其合并到原理图设计文件中。同样，可以建立代表VerilogHDL或VHDL设计文件的AHDL包含文件，并将其合并到文本设计文件中或另一个VerilogHDL或VHDL设计文件中。AHDL是一种完全集成到QuartusII系统中的高级模块化语言。AHDL支持布尔等式、状态机、条件逻辑和解码逻辑。AHDL还可用于建立和使用参数化函数，并完全支持LPM函数。AHDL特别适合设计复杂的组合逻辑、批处理、状态机、真值表和参数化逻辑。7．使用宏功能模块设计文件Altera宏功能模块是复杂的高级构建模块，可以在QuartusII设计文件中与逻辑门和触发器基本单元一起使用。Altera提供的参数化宏功能模块和LPM功能均为Altera器件结构做了优化。必须使用宏功能模块才可以使用一些Altera专用器件的功能，例如，存储器、DSP块、LVDS驱动器、PLL以及SERDES和DDIO电路。可以使用MegaWizardPlug-InManager（&Tools&菜单）建立Altera宏功能模块、LPM功能和IP功能，用于QuartusII软件和EDA设计输入与综合工具中的设计。表5.3列出了能够由MegaWizardPlug-InManager建立的Altera提供的宏功能模块和LPM功能类型。表5.3 Altera提供的宏功能模块与LPM功能表类型说明算术组件包括累加器、加法器、乘法器和LPM算术功能逻辑门包括多路复用器和LPM门功能I/O组件包括时钟数据恢复（CDR）、锁相环（PLL）、双数据速率（DDR）、千兆收发器块（GXB）、LVDS接收器和发送器、PLL重新配置和远程更新宏功能模块存储器包括FIFOPartitioner、RAM和ROM宏功能模块存储组件存储器，移位寄存器宏功能模块和LPM存储器功能
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max+plus ii下载Max+plusII是Altera公司推出的的第三代PLD开发系统(Altera第四代PLD开发系统被称为：QuartusII，主要用于设计新器件和大规模CPLD/FPGA).使用MAX+PLUSII的设计者不需精通器件内部的复杂结构。设计者可以用自己熟悉的设计工具（如原理图输入或硬件描述语言）建立设计，MAX+PLUSII把这些设计转自动换成最终所需的格式。其设计速度非常快。对于一般几千门的电路设计，使用MAX+PLUSII，从设计输入到器件编程完毕，用户拿到设计好的逻辑电路，大约只需几小时。设计处理一般在数分钟内内完成。特别是在原理图输入等方面，Maxplus2被公认为是最易使用，人机界面最友善的PLD开发软件，特别适合初学者使用。软件截图1功能介绍1.设计输入。在传统设计中，设计人员是应用传统的原理图输入方法来开始设计的。自90年代初， Verilog、VHDL、AHDL等硬件描述语言的输入方法在大规模设计中得到了广泛应用。2.前仿真（功能仿真）。设计的电路必须在布局布线前验证电路功能是否有效。（ASCI设计中，这一步骤称为第一次Sign-off）PLD设计中，有时跳过这一步。3.设计编译。设计输入之后就有一个从高层次系统行为设计向门级逻辑电路设转化翻译过程，即把设计输入的某种或某几种数据格式(网表)转化为软件可识别的某种数据格式(网表)。4.优化。对于上述综合生成的网表，根据布尔方程功能等效的原则，用更小更快的综合结果代替一些复杂的单元，并与指定的库映射生成新的网表，这是减小电路规模的一条必由之路。5.布局布线。在PLD设计中，3-5步可以用PLD厂家提供的开发软件（如 Maxplus2）自动一次完成。6.后仿真（时序仿真）需要利用在布局布线中获得的精确参数再次验证电路的时序。（ASCI设计中，这一步骤称为第二次Sign—off）。7.生产。布线和后仿真完成之后，就可以开始ASCI或PLD芯片的投产使用方法1. 运行&PCALTERA32BIT&目录下的&SETUP.EXE&,点击Install SoftwareMAX+PLUS II BASELINE Software安装软件。Next按钮完成安装。2. 第一次运行MAX+plus II时，会弹出一个&遵守协议&对话框，用鼠标将内容下拉到最后， 选择“OK“。3. 将安装盘目录下的******授权文件,复制到MAX+plus II的安装目录下（如&C:MAXPLUS2&目录）。4. 再次启动MAX+plus II，选择菜单[Option]-&[****** Setup]功能，在弹出的对话框中，按&Browse&按钮，选择刚才复制的授权文件，确认退出，退出MAX+plus II开发环境，再次运行MAX+plus II即可。5. 打开控制面板，打开添加/删除硬件：
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23:28:00谢谢楼主ygn Post at
17:52:00&TABLE&&WORD-BREAK:&break-all&&width=&90%&&border=0&&TR&&TD&10&LINE-HEIGHT:&14pt&&width=&100%&&&img&src=&http://www.52rd.com/bbs/Skins/Discuz/topicface/none.gif&&&&B&&/B&谢谢楼主&/TD&&/TR&&/TABLE&ZHAO47 Post at
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0:45:00自己总结的东西才是最好的&支持你blueprince Post at
17:09:00太感谢楼主了jingsong Post at
17:16:00谢谢楼主[em01]jingsong Post at
17:16:00怎么不能下啊blueprince Post at
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23:39:00&P&不错的科普读物&/P&wjyok Post at
13:28:00&P&好东西！&/P&bobodu Post at
21:05:00&P&谢谢分享&/P&[em01]yanmings Post at
16:33:00&P&吐血支持啊！自已的宝贵经验还不要钱，项！&/P&zwj303 Post at
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21:55:00&P&thank&you&very&much&/P&[em12]jindouyun Post at
15:58:00楼主我刚刚注册,相信是好东西,我会再来的,我是新手!希望大侠们提供更多有用的资料,谢谢![em01]jindouyun Post at
9:05:00QuartusII和dsp&builder的licence问题怎么解决,帮帮忙,谢谢!bearxzg168 Post at
16:50:00多谢楼主的资料，支持duan1234 Post at
23:48:00&BLOCKQUOTE&&P&align=left&Altera公司最近发布了QuartusII4.0软件，我们进行了试用，发现4.0在界面和功能上都发生了不少变化，比如支持MaxplusII界面，支持RTL&View（也就是通常所讲的查看HDL对应的电路原理图）等等。我们将这些新特性总结成文，相信QuartusII和MaxplusII的使用者都会比较感兴趣。&/P&&P&align=left&&&/P&&P&align=left&&b&QuartusII&4.0新特性之一：支持MaxplusII操作界面&/b&&/P&&P&align=left&&&/P&&P&align=left&MaxplusII是一套非常成功的PLD开发软件，虽然QuartusII已经推出了4年，并且Altera宣布不再对MaxplusII进行升级，但至今仍有非常多的工程师在使用MaxplusII。&Altera在QuartusII4.0中允许将软件界面设置为MaxplusII风格，以吸引MaxplusII的用户转向QuartusII。&/P&&P&align=left&安装QuartusII&4.0时，软件会自动询问，你准备使用何种界面：QuartusII还是MaxplusII&/P&&P&align=left&&&/P&&/BLOCKQUOTE&&P&&img&src=&http://www.fpga.com.cn/altera/training/Q4/install1.gif&&&/P&&BLOCKQUOTE&&P&align=left&选择MaxplusII界面，运行QuartusII4.0时，展现在我们面前的是一个非常类似于MaxplusII的操作环境，主要菜单和MaxplusII几乎一样：&/P&&/BLOCKQUOTE&&P&&img&src=&http://www.fpga.com.cn/altera/training/Q4/M1.gif&&&/P&&P&使用MaxplusII风格的QuartusII4.0&/P&&P&&img&src=&http://www.fpga.com.cn/altera/training/Q4/m2timing.gif&&&/P&&P&和MaxplusII相似的延时分析工具&/P&&BLOCKQUOTE&&P&align=left&&&/P&&P&align=left&安装完毕以后，也可以在菜单:Tools&Customize中进行更改，在两种界面风格中进行切换:&/P&&/BLOCKQUOTE&&P&&img&src=&http://www.fpga.com.cn/altera/training/Q4/change.gif&&&/P&mabenli Post at
12:25:00&P&楼主真上好人!&/P&Alickers Post at
11:15:00&P&买不起&也顶一个！&/P&Alickers Post at
8:47:00&P&正在下载&/P&&P&回去学习学习：）&/P&天堂雨 Post at
21:55:00楼主好人，一定顶上来xyweiw Post at
18:52:00谢谢楼主,支持![em26][em26]cuittao Post at
12:47:00thank&you&very&muchshawn_518 Post at
17:25:00好东东，thanksLIUERHU Post at
16:37:00是5.0版本的hling Post at
15:38:00真是好东西，谢谢阿[em01]eric_xa Post at
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11:05:00搂主好人啊[em14]wangtou Post at
20:51:00谢楼主！moon_hh Post at
14:18:00大力提倡象楼主这样的好人啊cdzcx Post at
16:37:00谢谢[em01][em01]siyuan1228 Post at
15:38:00谢谢楼主[em08]zhouqiang82 Post at
8:28:00顶，赞楼主rpwind0206 Post at
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