PCB设计中上拉蓝白可调电阻引脚与芯片引脚之间的线用加粗吗

来源：蜘蛛抓取(WebSpider) 时间：2017-10-31 02:34 标签： 可变电阻引脚
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芯片引脚串联电阻的目的
22:54:13　　
高速数字电路中，经常看到在两个芯片的引脚之间串连一个电阻，是为了避免信号产生振铃（即信号的上升或下降沿附近的跳动）。原理是该电阻消耗了振铃功率，也可以认为它降低了传输线路的Q值。通常在数字电路设计中要真正做到阻抗匹配是比较困难的，原因有二：1、实际的印制板上连线的阻抗受到面积等设计方面的限制；2、数字电路的输入阻抗和输出阻抗不象模拟电路那样基本固定，而是一个非线性的东西。实际设计时，我们常用22到33欧姆的电阻，实践证明，在此范围内的电阻能够较好地抑制振铃。但是事物总是两面的，该电阻在抑制振铃的同时，也使得信号延时增加，所以通常只用在频率几兆到几十兆赫兹的场合。频率过低无此必要，而频率过高则此法的延时会严重影响信号传输。另外，该电阻也往往只用在对信号完整性要求比较高的信号线上，例如读写线等，而对于一般的地址线和数据线，由于芯片设计总有一个稳定时间和保持时间，所以即使有点振铃，只要真正发生读写的时刻已经在振铃以后，就无甚大影响。
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限流的吧，起保护作用
18:04:30　　
楼主说的这个，我见到过，CLK 差分线上接一个电阻。
19:45:44　　
楼主说的这个，我见到过，CLK 差分线上接一个电阻。
那么这个电阻起什么作用
20:09:38　　
那么这个电阻起什么作用
我还真没有理解，不过觉得楼主说的有点意思。
20:12:03　　
我还真没有理解，不过觉得楼主说的有点意思。
好的 我再看看& && &
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刚好学习了
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Protel99SE：LD3320.ddb 包含原理图和PCB 封装，版本：Protel99 SE
一、原理图
LD3320 管脚主要分成数字与模拟两部分，各有自己的电源管脚，下面是管脚概述：
I/O 电源（1.65V ~ VDD）
数字逻辑电路用电源（3.0V ~ 3.3V ）
I/O 和数字电路地
麦克风输入（P 表示正极，N 表示负极）
单声道线路输入Mono LineIn
麦克风偏置
双声道线路输入（左右端）LineIn
耳机输出（左右端）
声音信号参考电压
模拟电路电源（3.0V ~ 4.0V ）
喇叭音量外部控制1
喇叭音量外部控制2
喇叭音量外部控制3
SPO[N ，P]
喇叭输出（P 表示正极，N 表示负极）
LOUT[L，R]
线路输出LineOut
参考数据手册相关说明 附录B.4
输入时钟（4~48MHz
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为什么要用上拉和下拉电阻
09:20:11　　
为什么要用上拉和下拉电阻？
1、当TTL电路驱动COMS电路时，如果TTL电路输出的高电平低于COMS电路的最低高电平（一般为3.5V），这时就需要在TTL的输出端接上拉电阻，以提高输出高电平的值。
2、OC门电路必须加上拉电阻，才能使用。
3、为加大输出引脚的驱动能力，有的单片机管脚上也常使用上拉电阻。
4、在COMS芯片上，为了防止静电造成损坏，不用的管脚不能悬空，一般接上拉电阻产生降低输入阻抗，提供泄荷通路。
5、芯片的管脚加上拉电阻来提高输出电平，从而提高芯片输入信号的噪声容限增强抗干扰能力。
6、提高总线的抗电磁干扰能力。管脚悬空就比较容易接受外界的电磁干扰。
7、长线传输中电阻不匹配容易引起反射波干扰，加上下拉电阻是电阻匹配，有效的抑制反射波干扰。
09:48:59　　
看看datasheet，，，，
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提高IO口的驱动能力 还有就是匹配电压
15:11:53　　
加上下拉电阻是电阻匹配，有效的抑制反射波干扰
高级工程师
15:37:28　　
讲的很全面。&&
17:09:16　　
加上下拉电阻是电阻匹配，有效的抑制反射波干扰
这个要赞。
20:30:08　　
加上下拉电阻是电阻匹配，有效的抑制反射波干扰
能举个具体的例子讲一下吗&&谢谢
12:17:10　　
能举个具体的例子讲一下吗&&谢谢
09:20:07　　
15:26:25　　
知识点总结的不错
15:36:37　　
说的还是可以的，学习学习
14:30:53　　
51单片机驱动流水灯一般都要用
14:31:46　　
楼主附带点数据计算验证，就更好了
01:17:56　　
17:03:24　　
之前学模电老师专门强调过，忘了
19:47:55　　
51单片机驱动流水灯一般都要用
51单片机只有P0口要上拉
23:54:34　　
51单片机只有P0口要上拉
补充其他端口驱动发光二极管用排阻，是用来防止二极管烧掉的限流电阻
13:32:32　　
给个赞，挺有用的
14:52:26　　
高级工程师
19:48:38　　
不管是上拉电阻还是下拉电阻，作用只有一个：抗干扰！
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