iphone a8处理器运行速度具体是多少？_百度知道
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iphone a8处理器运行速度具体是多少？
iPhone A8处理器的好处：1、A8处理器相比A7处理器节能50%。尽管尺寸变得更小，A8处理器内部却拥有20亿个晶体管，相当于A7CPU中晶体管数量的2倍多。2、A8芯片比A7芯片CPU性能提升25%，图形性能提高了50%，并且由于采用了20nm的工艺，因此效能也比之前出色。3、A8处理器集成了M8运动协处理器，会持续测量来自加速感应器、指南针、陀螺仪和全新气压计的数据，为A8芯片分担更多的工作量，从而提升了效能。
采纳率：72%
iPhone 6/6 Plus所搭载的苹果A8处理器是1.4GHz双核。
每秒多少次？
你想问什么？
1.4GHz就是运行频率
iphone a8处理器每秒可以进行多少次运算
苹果发布会从来都不怎么谈处理器规格，只能通过跑分去推测性能。
苹果对处理器的信息都是严格保密的
这是CPU单线程和多线程性能测试
本回答被提问者采纳
而在当时Intel Haswell桌面架构和排序缓冲大小也不过如此.0GHz明显低了不少，但是因为每个时钟周期最多可以同时解码，支持64位指令集。此架构首次出现是在iPhone 5S上，当时采用cyclone架构的A7芯片是移动端第一款64位处理器，虽然是双核处理器，但是晶体管数量却由10亿翻倍至20亿。这种制造工艺的提升带来最大的好处便是发热与功耗的降低、发射、执行;S。从测试成绩上来看，A8对于A7也是确实有着明显的升级，单线程成绩更加突出，而安卓阵营的新旗舰韩版Note 4，其采用的猎户座5433处理器也是一颗64位处理器.3GB&#47，但是A8性能对于A7还是有了25%左右的提升，而根据真机实测，A8在单线程上相比较于A7有近18%的提升，多线程则有15%的提升。在带宽上达到了12.8GB/S,这种水平虽然还不及高通骁龙801这样的带宽狂魔的14，由台积电负责制造。在芯片的大小上，比A7缩小13%，第二代cyclone架构，同样是64位，但在 CPU 单线程上还处于落后位置。
除了这些性能上的提升之外，但是由于iPhone分辨率最高只有1080p，其所需要的带宽约为8，运行频率也只有1.3GHz。到了A8处理器上，苹果依旧是发挥强大的芯片设计能力.9GB&#47A8处理器，这是苹果基于ARM授权，使用ARMv8架构，自行研发的一颗芯片。苹果基于对ARMv8的研究与调整、收回6个指令/微操作，排序缓冲大小是A6处理器的四倍多，因此12.8GB/S这样的带宽已经足够，缓存也还是64k、1MB、4MB，不过在制造工艺上已经进入了20nm时代
虽然不如A6升级至A7那样性能翻倍，得出cyclone（飓风）架构，A8芯片也是目前制造工艺最为先进的移动处理器，20nm制程，相比较安卓机中常见的2;S
每秒多少次？
几赫兹就是几千次呀
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回答问题，赢新手礼包学习android开发,我CPU是AMD A8-4500m的，基本上打不开虚拟机，大神分享下使用i5 CPU开发的本子？谢谢_百度知道
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学习android开发,我CPU是AMD A8-4500m的，基本上打不开虚拟机，大神分享下使用i5 CPU开发的本子？谢谢
我有更好的答案
个跟CPU关系不是特别大，如果你想打开android模拟器快点的话，console控制台上显示什么，我就是这么做的)，速度可能会快点，但是如果长期处于启动界面的话，一般来说，有两方面原因1、SDK的某一个API版本更新不完整，建议你换一个低版本的API 版本试试看，2.电脑驱动什么的可能是缺什么你可以看看启动模拟器的时候，可以用SSD硬盘(将SDK和开发工具如eclipse/android studio都放在SSD硬盘里面
是我CPU性能不行，启动android studio时，CPU使用率100%了，使用Intel的CPU，它能提供硬件加速，AMD就不行，所以太慢了。我现在就是想换个新电脑，用i5的CPU,希望能快速启动，运行流畅，当然买个SSD的本子更好，不过预算有限。
采纳率：31%
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回答问题，赢新手礼包谁用A8 这个CPU 可以几开_百度知道
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谁用A8 这个CPU 可以几开
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于已经淘汰的amd的apu了。现在看性能很一般。并且功耗发热全比较高，升级空间很小。配上最少4g内存。这个cpu四开是没问题的。要求高的3d的网游就不行了。大话这样的2d网游
采纳率：85%
来自团队：
用于多媒体和信号处理的NEON™运行时间编译目标（RCT）技术Cortex-A8架构是没有真双核的就说Cortex-A8还是不错的！Cortex-A8处理器是ARM的第一款超标量处理器，具有提高代码密度和性能的技术;技术，以及用于高效地支持预编译和即时编译Java及其他字节码语言的Jazelle&#174
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回答问题，赢新手礼包嵌入式系统（8）
第3章 Cortex-A8处理器编程
一．ARM编程简介
在嵌入式系统开发中，目前使用的主要编程语言是C和汇编。很多地方，例如开机时硬件系统的初始化，包括CPU状态的设定、中断的使能、主频的设定、以及RAM的控制参数及初始化等都使用汇编语言。汇编语言是和CPU的指令集紧密相连的，作为涉及底层的嵌入式系统开发，汇编语言编程不可或缺的重要方法。
二．Cortex-A8处理器模式和状态
1.处理器模式
2.处理器状态
Cortex-A8处理器有3种操作状态，这些状态由CPSR寄存器的T位和J位控制。
1)&&&&&&&ARM状态：执行32位字对齐的ARM指令，T位和J位为0。
2)&&&&&&&Thumb状态：执行16位或32位半字对齐的Thumb2指令，T位为1，J位为0。
3)&&&&&&&ThumbEE状态：执行为动态产生目标而设计的16位或32位半字对齐的Thumb2指令集的变体。T位和J位为1。
处理器的操作状态可以在以下几种状态间转换：
1)&&&&&&&&&ARM状态和Thumb状态之间转换
使用BL和BLX指令，并加载到PC。
2)&&&&&&&&&Thumb状态和ThumbEE状态之间转换
&& 使用ENTERX指令和LEAVEX指令。
&& 异常会导致处理器进入ARM状态或Thumb状态。一般情况，当退出异常处理时，处理器会恢复原来的T位和J位的值。（异常只能在RAM或Thumb状态下完成）
三．Cortex-A8存储器组织
1.数据类型
Cortex-A8支持以下数据类型：
1)双字，64位；2)字，32位；3)半字，16位；4)字节，8位。
&&& 当这些数据类型为无符号数据时，为普通二进制格式，N位数据值代表一个非负整数（范围为0～2N-1）；当这些数据类型为有符号数据时，为二进制补码格式，N位数据值代表一个整数（范围为-2N-1～2N-1-1）。
&&& 为了达到最好的性能，数据必须按照以下方式对齐：
&以字为单位时，按4字节对齐；
&以半字为单位时，按2字节对齐；
&以字节为单位时，按1字节对齐。
&&& Cortex-A8处理器支持混合大小端格式和非对齐数据访问。
2.存储格式
Cortex-A8处理器支持小端格式和字节不变的大端格式。此外，处理器还支持混合大小端格式（既有大端格式又有小端格式）和非对齐数据访问。对指令的读取，则总是以小端格式操作。
例如：对于0x数据，大端模式和小端模式的存放如图所示。
3.寄存器组
1)&&&&&&Cortex-A8处理器总共有40个32位长的寄存器。
a)&&&&&&33个通用寄存器。
b)&&&&&&7个状态寄存器：
&&& ——1个CPSR（Current Programs Status Register，当前程序状态寄存器）；
&&& ——6个SPSR（Saved Program Status Register，备份程序状态寄存器）。
这些寄存器不能同时访问，处理器状态和操作模式决定了哪些寄存器对编程者是可用的。
引起处理器模式改变的方式：软件控制、外部中断、异常处理。
除用户模式外，其他模式统称为特权模式。
特权模式：为了服务中断或异常，或访问保护的资源，可以自由地访问系统资源和改变模式。
异常模式：管理、中止、未定义、IRQ、FIQ、监控
2)&&&&&&通用寄存器
a)&&&&&&&&未分组的通用寄存器R0—R7
16个数据寄存器中R0--R7是未分组的通用寄存器，用来保存数据和地址。
b)&&&&&&&&分组通用寄存器R8—R15，处理器模式决定物理寄存器
——R8—R12寄存器：快速中断及其他模式两组；
——R13，R14寄存器：分7组，用户和管理模式共用；
R13：又称SP，堆栈指针
R14：又称LR，链接寄存器
——R15：又称PC，程序计数器，所有模式共用，在ARM状态下，PC字对齐；在Thumb和ThumbEE状态下，PC半字对齐。
3)&&&&&&状态寄存器（P44-46）
处理器有两类程序状态寄存器：1个当前程序状态寄存器CPSR和6个状态保存寄存器SPSR，
当前状态寄存器CPSR：所有模式共用；
分组的状态保存寄存器SPSR：6个异常模式对应。
主要功能如下：
a)&&&&&&保存最近执行的算术或逻辑运算的信息；
b)&&&&&&控制中断的允许或禁止；
c)&&&&&&设置处理器操作模式。
?& 条件标志位：N 、Z、C、V（算术或逻辑操作、MSR指令设置）
?& Q标志位：指定用于指示增强的DAP指令是否发生了溢出（通过MSR指令可清零）
?& J位：用于处理器是否处于ThumbEE状态
当T= 1时，J=0，Thumb状态；J=1，ThumbEE状态
注：T=0时，不能设置J=1（T=0，J=0）；不能通过MSR指令来改变CPSR的J位
?& GE[3:0]位：表示在SIMD指令集中的大于、等于标志。在任何模式下可读可写
?& E位：0表示小端操作，1表示大端操作
?& A位：异步异常禁止
n& ——中断屏蔽位：I=1，IRQ中断被中止；F=1，FIQ中断被禁止
n& ——T位：T=1，J决定处于Thumb或ThumbEE状态；T=0，ARM状态
（不要用MSR指令强行改变T位）
n& ——模式位
异常是处理外部异步事件的一种方法，在有些处理器架构中称为中断。
1.异常入口
2.异常退出
3.复位异常
复位也是一种异常。当复位信号产生时，复位发生处理器放弃正在执行的指令。当复位信号失效之后，处理器会采取如下动作：
1)&&&&&&将CPSR置为10011，安全Supervisor（管理）模式。
2)&&&&&&将CPSR的A、I、F位置为1。（关中断，禁止异常发生）
3)&&&&&&将CPSR的J位置0，根据CFGTE输入的状态来决定CPSR的T位；CPSR的其他位不确定。
4)&&&&&&强制PC从复位向量地址中获取下一条指令。
5)&&&&&&根据CFGTE输入的状态，在ARM或者Thumb状态下执行恢复操作。
6)&&&&&&复位之后，除了PC和CPSR以外的所有的寄存器的值都是不确定的。
4.快速中断异常（FIQ）
FIQ异常支持快速中断。FIQ模式有8个专用寄存器。
退出FIQ指令：SUBS PC, R14_fiq, #4
可以通过设置CPSR的F标志位，在特权模式中禁止FIQ。
5.中断异常（IRQ）
IRQ比FIQ优先级低。当处理器进入FIQ处理时，IRQ会被屏蔽。
退出IRQ指令：SUBS PC, R14_fiq, #4
可以通过设置CPSR的I位在特权模式下禁止IRQ异常。
6.中止异常&&&&&&&&&&&&&&&&&&&
试图访问无效的指令或数据内存单元通常都会引起中止。
——预取指中止：预读取中止发生时，处理器将标志这条预读取指令无效，但是直到执行这条指令才产生异常。
——数据中止：试图访问无效的数据内存单元引起。
处理完中止后执行指令：SUBS PC, R14_abt, #4（恢复PC和CPSR，重试被中止的指令）
7.软件中断异常
SVC指令进入管理模式，通常是为了请求一个特殊的管理员功能。SVC处理程序通过读取操作码来提取SVC功能号。
处理完返回指令：MOVS PC, R15_svc（恢复PC和CPSR，返回到SVC下一条指令）
8.监控异常
当处理器执行SMC指令，内核进入监控模式请求监控功能。用户进程执行SMC会导致一个未定义的指令异常发生。
9.未定义指令异常
当遇到一条处理器或系统协处理器无法处理的指令时，则产生未定义指令异常。软件可以利用这种机制，通过模拟未定义的协处理器指令来扩展ARM指令集。
MOVS PC, R14_und（恢复CPSR，返回到未定义指令异常的下一条指令，未定义指令发生时，IRQ异常会屏蔽）
10.断点异常
执行断点指令BKPT，产生一个预取中止异常。在指令到达流水线执行阶段前，不会引起处理器产生预取中止异常。
处理完断点后，执行指令：MOVS PC, R14_abt, #4（恢复PC和CPSR，重试断点指令）
11.异常向量
异常出现后处理器强制从异常类型所对应的固定存储器地址开始执行程序，这些地址称为异常向量（exception vectors）。在没有进行虚拟内存映射时，异常向量表放置于物理内存地址最低处。
当系统配置使能时，低端的异常向量表可以映射到特定的高端地址0xFFFF0000~0xFFFF001C处，改变后的地址位置称为高端向量。(P50)
12.异常的进入
当处理一个异常时，ARM9内核完成以下动作：
（1）将下一条指令的地址保存在相应的LR寄存器中。
（2）将CPSR复制到相应的SPSR中。
（3）迫使CPSR模式位M[4：0]的值设置成对应的异常模式值
（4）迫使PC从相关的异常向量取下一条指令。
（5）用户可以设置中断禁止位来阻止或打开异常嵌套。如果在异常发生时处理器是在Thumb状态下，自动切换进入ARM状态。
13.异常的退出
在完成异常处理后，ARM9完成以下动作：
（1）将LR寄存器的值减去相应的偏移量（偏移量根据异常的不同而不同），送到PC中。
（2）将SPSR复制回CPSR中。
（3）清除中断禁止位标志。
五．寻址方式
寻址方式是根据指令中给出的地址码字段来寻找真实操作数地址的方式。ARM处理器支持的基本寻址方式有以下几种：
1.寄存器寻址
所需要的值在寄存器中，指令中地址码给出的是寄器编号，即寄存器的内容为操作数。
ADD& R0，R1，R2&&&&&& ；R0=R1+R2
2.立即寻址
指令中在操作码字段后面的地址码部分不是操作数地址，而是操作数本身。
SUBS& R0，R0，#1&&&&&& ；R0ssR0 - 1
MOV& R0，#0xff00&&&&&& ；R0ss0xff00
3.寄存器移位寻址
寄存器移位寻址方式是ARM指令集中所特有的，第二个寄存器操作数在与第一个操作数结合之前，选择进行移位操作。可以采取的移位操作如下：
&LSL：逻辑左移，寄存器中字的低端空出的位补0。
&LSR：逻辑右移，寄存器中字的高端空出的位补0。
&ASR：算术右移。 算术移位的对象是带符号数。
&ROR：循环右移，从低端移出的位填入高端空出的位。
&RRX：带扩展的循环右移，操作数右移一位，空位用原C 标志值填充。
ADD R3，R2，R1，LSL #3&&&&&&&；R3=R2+8×R1
4.寄存器间接寻址
指令中的地址码给出某一通用寄存器的编号，在被指定的寄存器中存放操作数的有效地址，而操作数则存放在该地址对应的存储单元中，即寄存器为地址指针。
LDR R0，[R1]&&&&&&&&&&&& ；R0=[R1]
SWP R1，R1, [R2]&&&&&&& ；R0与[R1]数值进行交换
5.变址寻址
变址寻址就是将基址寄存器的内容与指令中给出的偏移量相加，形成操作数有效地址。变址寻址用于访问基址附近的单元，包括基址加偏移和基址加索引寻址。寄存器间接寻址是偏移量为0的基址加偏移寻址。
基址加偏移寻址中的基址寄存器包含的不是确切的地址。基址需加（或减）最大4KB的偏移来计算访问的地址。
LDR R0，[R1，#4]&&&&&&& ；R0=[R1+4]
STR R1，[R0，#-2]&&&&&&& ；[R0-2]ssR1
LDR R0，[R3，R2]&&&&&&& ；R0ss[R3, R2]
6.多寄存器寻址
一次可以传送几个寄存器的值，允许一条指令传送16个寄存器的任何子集。
LDMIA R1，{R0，R2，R5} ；R0=[R1]，R2=[R1+4]，R5=[R1+8]
;由于传送的数据项总是32位的字，基址R1应该字对准。
STMIA R0!，{R3-R6，R10}&& ；[R0]=R3，[R0+4]=R4，；[R0+8]=R5，[R0+12]=R6，[R0+16]=R10
7.堆栈寻址
&& &堆栈是一种按特定顺序进行存取的存储区，这种特定顺序既是“先进后出”或“后进先出”。堆栈寻址是隐含的，它使用一个专门的寄存器（堆栈指针）指向一块存储器区域。栈指针所指定的存储单元就是堆栈的栈顶。堆栈可分为两种：
向上生长，又称递增堆栈，即地址向高地址方向生长。
向下生长，又称递减堆栈，即地址向低地址方向生长。
满堆栈，堆栈指针指向最后压入堆栈的有效数据项。
空堆栈，堆栈指针指向下一个数据项放入的空位置。
STMFD& SP!,{R1-R7,LR}&& ;将R1-R7，LR入栈，满递减堆栈
LDMFD SP!,{R1-R7,LR}& ;数据出栈，放入R1-R7,LR寄存器
8.块拷贝寻址
块拷贝寻址指令是一种多寄存器传送指令，多寄存器传送指令用于把一块数据从存储器的某一位置拷贝到另一位置。块拷贝指令的寻址操作取决于数据是存储在基址寄存器所指的地址之上还是之下、地址是递增还是递减，并与数据的存取操作有关。
A--&after,B--&before
STMIA R0!,{R1-R7}；将R1~R7数据保存到存储器中，存储器指针在保存第一个值之后增加，方向为向上增长
STMIB R0!,{R1-R7}&；将R1~R7数据保存到存储器中，存储器指针在保存第一个值之前增加，方向为向上增长
LDMFB R0!,{R1-R7}&；将R1~R7数据保存到存储器中，存储器指针在保存第一个值之后增加，方向为向下增长
LDMFA R0!,{R1-R7}&；将R1~R7数据保存到存储器中，存储器指针在保存第一个值之前增加，方向为向下增长
9.相对寻址
相对寻址是变址寻址的一种变通，由程序计数器PC提供基地址，指令中的地址码字段作为偏移量，两者相加后得到操作数的有效地址。偏移量指出的是操作数与当前指令之间的相对位置。子程序调用指令即是相对寻址指令。
目标地址 = pc 当前值 + 指令给出的标号偏移地址
BL SUB1；调用SUB1子程序
&&&&&&&&&& BEQ LOOP；条件跳转到LOOP标号处
&&&&&&&&&&&&。。。
&&&&&&&&&&& LOOP&& MOV R6,#1
SUB1&&& 。。。
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