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LCD12864 C语言驱动
[导读]#includesbit RS=P2^0;sbit RW=P2^1;sbit EN=P2^2;sbit CS1=P2^3;sbit CS2=P2^4;sbit RST=P2^5;#define databus P0#define uchar unsigned char#define startline 0xc0#define displayon 0x3f#define startcolumn 0x
#include本文引用地址: sbit RS=P2^0;sbit RW=P2^1;sbit EN=P2^2;sbit CS1=P2^3;sbit CS2=P2^4;sbit RST=P2^5;#define databus P0#define uchar unsigned char#define startline 0xc0#define displayon 0x3f#define startcolumn 0x40#define page 0xb8void init();void clearscreen(uchar);void readbusy();void writecmd(uchar);void writedata(uchar);//uchar readdata();void main(){uchar i,j;/*-- 文字: 孟 --*//*-- 宋体12; 此字体下对应的点阵为：宽x高=16x16
--*/uchar code str[][16]={0x00,0x10,0x10,0x10,0x11,0x11,0x91,0x11,0xF9,0x15,0x13,0x11,0x10,0x10,0x10,0x00,0x40,0x40,0x40,0x7E,0x42,0x42,0x7E,0x43,0x42,0x7E,0x42,0x42,0x7E,0x40,0x40,0x00};init();CS1=0;CS2=1;for(i=0;i<2;i++){writecmd(i|page);writecmd(startcolumn);for(j=0;j<16;j++){ writedata(str[i][j]);}}while(1);}void init(){RST=0;RST=1;CS1=0;CS2=0;writecmd(displayon);writecmd(startline);clearscreen(0);}void clearscreen(uchar select){uchar i,j;switch(select){case 0:CS1=0;CS2=0;case 1:CS1=0;CS2=1;case 2:CS1=1;CS2=0;default:CS1=1;CS2=1;}for(i=0;i<8;i++){writecmd(i|page);writecmd(startcolumn);for(j=0;j<64;j++){ writedata(0);}}}void readbusy(){RS=0;RW=1;do{databus=0EN=1;ACC=EN=0;}while(ACC&0X80);}void writecmd(uchar cmd){readbusy();RS=0;RW=0;databus=EN=1;EN=0;}void writedata(uchar dat){readbusy();RS=1;RW=0;databus=EN=1;EN=0;}/*uchar readdata(){readbusy();RS=1;RW=1;databus=0EN=1;temp=EN=0;readbusy();RS=1;RW=1;databus=0EN=1;temp=EN=0;}*/特别要注意的是读忙子程序，如果这个没有处理好，屏幕就是一团漆黑。曾经在这个上面浪费了许多时间，Keil c51编译器支持在c代码中使用累加器ACC，这点非常好。因为我之前写过12864的汇编驱动，仿真和实际硬件上都能正常运行，但是换成c语言后想一一对照来写，却被卡在了ACC使用上。READBUSY: CLR RS
MOV DATABUS,#0FFHP0口作为通用输入口读取数据时，应先写1. SETB EN MOV A,DATABUS CLR EN而在连续读取数据时，可以不用写1. JB
ACC.7,BUSY_0
RET因为MOV A,DATABUS这句不好直接翻译成c，而现在用了ACC之后写的c代码反汇编后和汇编代码一样，而且驱动正常了。
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SoC FPGA上的策略考虑
引言本文引用地址: 　　集成了 FPGA 架构、硬核 CPU 子系统以及其他硬核 IP 的半导体器件 SoC FPGA 已经发展到了一个&关键点&，它在今后十年中会得到广泛应用，为系统设计人员提供更多的选择。对于在 FPGA 上开发的系统，这些 SoC FPGA 完善了十多年以来的软核 CPU 以及其他软核 IP。各种技术、商业和市场因素相结合推动了这一关键点的出现，Altera、Cypress &半导体、Intel &和 Xilinx &公司等供应商都发布或者开始发售 SoC FPGA 器件。　　这一关键点的主要推动因素包括：　　过渡到并行和多核处理，以提高功效。　　FPGA成为前沿的新半导体工艺技术　　嵌入式系统中越来越多的使用了FPGA　　摩尔定律的经济现实　　CPU在体系结构上的增强　　随着SoC FPGA时代的来临，系统设计人员在选择这些器件时需要考虑以下关键策略问题：　　哪些器件会经历&平台效应&，使得供应商、辅助支撑系统以及用户之间出现 &自我增强循环&?　　哪些器件能够在多种选择中支持IP重用?　　哪些FPGA技术能够最大限度的降低成本，提高性能 ?　　SoC FPGA 的关键点　　业界集成FPGA和CPU系统在第一个十年发展中既有成功也有失败。最初的SoC FPGA在商业上并不是很成功 (2)，而 FPGA 中的软核 CPU 得到了广泛应用 (3)，这表明市场对FPGA和CPU技术集成有基本的需求。各种新的因素改变了业界环境，导致关键点的出现，SoC FPGA将在市场上获得非常广泛的应用。　　推动业界这一关键点出现的关键因素包括：　　计算功效　　FPGA 过渡到前沿工艺技术　　FPGA 在嵌入式系统中的应用　　摩尔定律的经济现实　　CPU 在体系结构上的增强　　计算功效　　计算的发展趋势是并行处理，近期集中在处理器从高成本的单核处理发展到多核实现上 (4)。在提高计算性能的同时降低功耗，这促使人们采用 FPGA逻辑作为CPU的硬件加速器。(5)　　一个 SoC FPGA 系统提高了功效，实现了灵活的软件划分。SoC FPGA 支持数百路数据信号连接不同的功能区，实现每秒100-gigabits (Gbps) 带宽，甚至更大的带宽，其延时在纳秒级，性能和延时比分立器件要高几个数量级。而且，单个集成平台支持存储器控制器的共享，宽带存储器可以访问硬件加速器。　　性能的提高以及存储器访问功能支持采用 FPGA来实现功能更强的加速器，以满足各种各样的计算要求。由于硬件加速器在功效上要比 CPU 高 1，000 多倍，因此，与简单的多核并行方法相比，采用 SoC FPGA 进行设计是实现高功效计算较好的方法。　　FPGA过渡到前沿工艺技术　　在 2000 年，最新的 FPGA 采用了 130-nm 工艺技术进行开发，而目前的 CPU 采用的是90-nm 工艺技术。由于有更高级的 CPU，因此，第一代 SoC FPGA 的推出有些滞后。然而，当今的前沿FPGA采用28-nm工艺技术，相对而言只有很少的商用 CPU或者ASSP使用了这一工艺技术，当然在今后有可能使用该技术。FPGA在工艺技术上的优势明显增强了这些集成器件的市场潜力，供应商也倾向于在这方面加大投入，这是因为设计人员不需要在 CPU性能上作出牺牲，如图1 所示。　　　　图 1.FPGA 过渡到前沿工艺技术FPGA在嵌入式系统中的应用　　在2000年，对于大部分嵌入式系统应用，FPGA还是相对比较昂贵的器件，结果，与相应的 CPLD 或者 PAL 相比，其应用相对较少。然而，在过去十年中，基于 SRAM 的 FPGA在降低成本上超越了 CMOS，由此，EE Times年度嵌入式调查表明，接近50%的嵌入式系统采用了FPGA。(6) SoC FPGA 最显著的优势是成本比分立器件低很多，芯片供应商有很大的市场机会来获得投资回报。　　摩尔定律的经济现实　　摩尔定律显得越来越 &昂贵&。开发高级 CMOS半导体的制造设施成本大约在60亿到10亿美元 (7)。 由于需要 4千万美元的成本来开发新半导体器件 (8)，因此，在典型的利润模型中，半导体器件应能够获得1亿美元的毛利润，20%的收益要花在研发上。典型的毛利润是 50%时 (9) ，企业至少要占据2亿美元的市场份额。除了消费类电子、移动电话和PC之外，很少有能够达到这一规模的应用市场，因此，单一目的或者固定功能的器件很难获得投资回报。在今后的工艺技术中，高级半导体的成本会越来越高，这一成本结构使得开发固定功能半导体器件很难获得较好的经济回报，这表明在可编程逻辑技术上的投入会越来越多，而专用 ASSP和CPU等固定功能器件的投入会越来越少。SoC FPGA有潜力应用于很多市场领域，将会获得更多的投入。　　CPU在体系结构上的增强　　嵌入式处理这一术语涵盖了多种应用，从对成本非常敏感的4位处理器到非常复杂的多核64位处理器。相似的，这种广泛的应用一直支持各种类型的处理器、操作系统和软件供应商。与2000年相比，这种广泛性在2011年表现出很大的不同。对于其规模和多样性而言，嵌入式市场总体上向速度更快、功能更强的处理器发展;例如，16位微控制器逐渐被32位CPU替代。同时，四种应用最广泛的体系结构进一步增强了对32位 CPU 系列的支持，这些体系结构包括：ARM &、MIPS &、PowerPC &和 x86。之所以对其进行增强，主要是因为软件特性和功能重用 (10)。结果，采用了这些 CPU体系结构之一的SoC FPGA能够占据更大的市场，因此，供应商更愿意在这类半导体上加大投入。　　平台效应　　生产商、用户和辅助支撑系统在产品上彼此之间会有影响时，就会出现网络效应 (11)，或者称为平台效应。平台效应的基本原理是某一种产品或者标准的应用越多，它在用户基础和辅助支撑系统中的价值就越高。结果，用户基础和辅助支撑系统就会在这种技术上加大投入，从而吸引更多的应用，产生一种自我增强的良性循环。熟悉的例子包括PC (12)、视频记录格式 (13) 和社交网站等。　　一般而言，有可能产生自我增强循环的产品将会在这种循环中不断发展，这是因为参与到新产品中的所有成员都会获得较高的 ROI。平台一旦开始启动后，它会吸引更多的投入，活跃的市场很快就会转向这一标准。　　SoC FPGA 极有可能看到这种平台效应。随着 SoC FPGA 的不断发展，用户将非常愿意重新使用他们在多种系统中使用过的 FPGA IP 和设计软件。例如，CPU 辅助支撑系统中的成员愿意尽可能少的去学习 FPGA开发工具，而 CPU供应商则希望减少 FPGA开发工具的数量。结果，支持多家供应商和 CPU体系结构的SoC FPGA平台很有可能触发这种平台效应，帮助这些用户和辅助支撑系统成员获得很大的优势。　　Altera 的方法　　Altera在嵌入式系统上进行了多年的创新投入后，已经启动了&嵌入式计划&，目的是建立一个基于一种 FPGA设计流程方法的多家供应商、多 CPU 体系结构 SoC FPGA 平台。FPGA设计流程方法可以用作多种 SoC FPGA的基础，以及使用软核CPU和其他软核IP 的 SoC 解决方案。可以从 Altera 获得 ARM ( 硬核 )、MIPS ( 软核)和Nios& II (软核 ) CPU，而 Atom E6X5C 可配置处理器由 Intel 提供。这种集成方法在一种 FPGA 体系结构和设计流程中统一了三种主要的CPU体系结构以及最流行的基于FPGA的软核CPU。　　推动创新　　FPGA设计流程集成方法旨在激励辅助支撑系统从主要处理器体系结构转向投入单一FPGA平台和工具流程，从而带来丰富的工具、应用软件、操作系统软件和专业知识支持。随着数百家全球辅助支撑系统成员在 CPU体系结构上的投入，这一FPGA平台及其越来越多的工具、软件和IP应用越来越广泛，对系统设计人员越来越重要，表明其价值定位将促进应用，从而推动了良性平台循环。　　提供功能强大的工具和 IP　　这一多供应商平台的关键组成是对 FPGA 逻辑进行编程的 Quartus & II 软件流程。除了这些优点 (14)，Quartus II 软件还包括 Qsys 系统集成工具，它采用了 Altera 的第二代交换架构技术，用于加速软核 IP 的开发、重用和集成。基于 GUI 的 Quartus II 软件有免费的网络版和拥有完全许可的版本，其设计流程包括系统设计和时序收敛方法、在系统验证以及第三方EDA工具支持，满足了效能和性能需求。　　除了 Altera 传统的 Avalon &存储器映射 (Avalon-MM) 接口和数据通路总线接口规范，Qsys还支持ARM AXI &标准，可以采用自动的 &混合匹配&方法来集成基于Avalon的IP和基于AXI的 IP。Qsys支持您利用直观快速的设计经验，在通用平台上方便的进行设计重用和在系统验证，实现基于 ARM 和 Intel 的 SoC FPGA，以及 MIPS 和 Nios II 软核 CPU SoC 实现。　　定制 28-nm 系列器件　　Altera 的 28-nm FPGA 系列器件是业界最全面的器件，针对用户的各种设计需求进行定制 (15)。Altera为各种最终应用需求提供非常优异的FPGA体系结构和工艺技术&&性能最好的高密度 Stratix & V 器件，成本最优的大批量 Cyclone & V 器件，以及在性能和成本上达到均衡的中端 Arria & V 器件。全系列 SoC FPGA 受益于这种定制方法。　　Altera 最新的 SoC FPGA 将含有基于 ARM Cortex-A9MP 内核的高级处理器模块，如图2所示：　　　　图 2.Altera SoC FPGA 体系结构　　Altera SoC FPGA 体系结构在 ARM-Cortex A9 子系统中将含有多种硬核 IP，以及高性能多端口存储器控制器，以提高存储器带宽。FPGA和 CPU子系统之间的宽带低延时互联将支持高性能应用和高效的FPGA硬件加速。高级内部交换架构将支持高效的数据吞吐量，以及高效能在系统观察和调试。Qsys、Quartus II 软件以及 ARM 联络社区软件工具相结合后，这一器件将是一种性价比非常高的系统设计选择，它利用标准工具流程提高了效能，支持新开发和验证。　　结论　　SoC FPGA时代已经来临。在关键经济、技术和市场因素的推动下，这些器件达到了关键点，很多供应商已经发布了这些器件，或者开始发售。执行管理人员和系统规划人员在评估系统解决方案时应认真考虑平台效应、IP重用以及 FPGA工艺技术优势。　　Altera 与主要的 CPU 供应商 ARM、Intel 和 MIPS 合作，为 SoC FPGA 器件和软核 CPU 解决方案提供公共FPGA平台。这种合作关系能够实现业界应用最广泛的CPU体系结构及其辅助支撑系统，继承相同的高级 FPGA设计流程，从而在这一平台上增强了IP重用，提高了灵活性。这种集成方法实现了平台效应，促进了这一平台以及支持CPU及其辅助支撑系统的增长和发展。
基于ARM+FPGA的高速同步数据采集方案，主要包括以下几个部分：ARM控制器、存储电路、FPGA逻辑控制电路、A/D转换电路、FIFO缓存、电源电路、接口电路等。......关键字：
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从大学时代第一次接触FPGA至今已有10多年的时间，至今记得当初第一次在EDA实验平台上完成数字秒表、抢答器、密码锁等实验时那个兴奋劲。当时由于没有接触到HDL硬件描述语言，设计都是在MAX+plus II原理图环境下用74系列逻辑器件搭建......关键字：
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PCB布线设计（一）
[导读]在当今激烈竞争的电池供电市场中，由于成本指标限制，设计人员常常使用双面板。尽管多层板(4层、6层及8层)方案在尺寸、噪声和性能方面具有明显优势，成本压力却促使工程师们重新考虑其布线策略，采用双面板。在本文中
在当今激烈竞争的电池供电市场中，由于成本指标限制，设计人员常常使用双面板。尽管多层板(4层、6层及8层)方案在尺寸、噪声和性能方面具有明显优势，成本压力却促使工程师们重新考虑其布线策略，采用双面板。在本文中，我们将讨论自动布线功能的正确使用和错误使用，有无地平面时电流回路的设计策略，以及对双面板元件布局的建议。自动布线的优缺点以及模拟电路布线的注意事项设计PCB时，往往很想使用自动布线。通常，纯数字的电路板(尤其信号电平比较低，电路密度比较小时)采用自动布线是没有问题的。但是，在设计模拟、混合信号或高速电路板时，如果采用布线软件的自动布线工具，可能会出现一些问题，甚至很可能带来严重的电路性能问题。例如，图1中显示了一个采用自动布线设计的双面板的顶层。此双面板的底层如图2所示，这些布线层的电路原理图如图3a和图3b所示。设计此混合信号电路板时，经仔细考虑，将器件手工放在板上，以便将数字和模拟器件分开放置。采用这种布线方案时，有几个方面需要注意，但最麻烦的是接地。如果在顶层布地线，则顶层的器件都通过走线接地。器件还在底层接地，顶层和底层的地线通过电路板最右侧的过孔连接。当检查这种布线策略时，首先发现的弊端是存在多个地环路。另外，还会发现底层的地线返回路径被水平信号线隔断了。这种接地方案的可取之处是，模拟器件(12位A/D转换器MCPV参考电压源MCP4125)放在电路板的最右侧，这种布局确保了这些模拟芯片下面不会有数字地信号经过。图3a和图3b所示电路的手工布线如图4、图5所示。在手工布线时，为确保正确实现电路，需要遵循一些通用的设计准则：尽量采用地平面作为电流回路；将模拟地平面和数字地平面分开；如果地平面被信号走线隔断，为降低对地电流回路的干扰，应使信号走线与地平面垂直；模拟电路尽量靠近电路板边缘放置，数字电路尽量靠近电源连接端放置，这样做可以降低由数字开关引起的di/dt效应。这两种双面板都在底层布有地平面，这种做法是为了方便工程师解决问题，使其可快速明了电路板的布线。厂商的演示板和评估板通常采用这种布线策略。但是，更为普遍的做法是将地平面布在电路板顶层，以降低电磁干扰。图1 采用自动布线为图3所示电路原理图设计的电路板的顶层图2 采用自动布线为图3所示电路原理图设计的电路板的底层图3a 图1、图2、图4和图5中布线的电路原理图图3b 图1、图2、图4和图5中布线的模拟部分电路原理图有无地平面时的电流回路设计对于电流回路，需要注意如下基本事项：1. 如果使用走线，应将其尽量加粗PCB上的接地连接如要考虑走线时，设计应将走线尽量加粗。这是一个好的经验法则，但要知道，接地线的最小宽度是从此点到末端的有效宽度，此处“末端”指距离电源连接端最远的点。 2. 应避免地环路3. 如果不能采用地平面，应采用星形连接策略(见图6)通过这种方法，地电流独立返回电源连接端。图6中，注意到并非所有器件都有自己的回路，U1和U2是共用回路的。如遵循以下第4条和第5条准则，是可以这样做的。4. 数字电流不应流经模拟器件数字器件开关时，回路中的数字电流相当大，但只是瞬时的，这种现象是由地线的有效感抗和阻抗引起的。对于地平面或接地走线的感抗部分，计算公式为V = Ldi/dt，其中V是产生的电压，L是地平面或接地走线的感抗，di是数字器件的电流变化，dt是持续时间。对地线阻抗部分的影响，其计算公式为V= RI, 其中，V是产生的电压，R是地平面或接地走线的阻抗，I是由数字器件引起的电流变化。经过模拟器件的地平面或接地走线上的这些电压变化，将改变信号链中信号和地之间的关系(即信号的对地电压)。5. 高速电流不应流经低速器件与上述类似，高速电路的地返回信号也会造成地平面的电压发生变化。此干扰的计算公式和上述相同，对于地平面或接地走线的感抗，V = Ldi/dt ；对于地平面或接地走线的阻抗，V = RI 。与数字电流一样，高速电路的地平面或接地走线经过模拟器件时，地线上的电压变化会改变信号链中信号和地之间的关系。图4 采用手工走线为图3所示电路原理图设计的电路板的顶层图5 采用手工走线为图3所示电路原理图设计的电路板的底层图6 如果不能采用地平面，可以采用“星形”布线策略来处理电流回路图7 分隔开的地平面有时比连续的地平面有效，图b)接地布线策略比图a) 的接地策略理想6. 不管使用何种技术，接地回路必须设计为最小阻抗和容抗7. 如使用地平面，分隔开地平面可能改善或降低电路性能，因此要谨慎使用分开模拟和数字地平面的有效方法如图7所示图7中，精密模拟电路更靠近接插件，但是与数字网络和电源电路的开关电流隔离开了。这是分隔开接地回路的非常有效的方法，我们在前面讨论的图4和图5的布线也采用了这种技术。来源:0次本文引用地址:
在SMT和DIP的混合工艺中，为了避免单面回流焊一次，波峰焊一次的二次过炉情况，在PCB的波峰焊 焊接面的chip元件，器件的中心点点上红胶，可以在过波峰焊时一次上锡，省掉其锡膏印刷工艺。......关键字：
一般PCB基本设计流程如下：前期准备->PCB结构设计->PCB布局->布线->布线优化和丝印->网络和DRC检查和结构检查->制版。......关键字：
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PCB(Printed Circuit Board)设计软件经过多年的发展、不断地修改和完善，或优存劣汰、或收购兼并、或强强联合，现在只剩下Cadence和Mentor两家公司独大。“......关键字：
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S3C2440的ADC程序
[导读]使用ADC只需要对相应的寄存器进行配置，然后启动ADC即可，启动ADC有两种方法：1. 手动完成启动。2.读取上一次转换结果后自动启动下一次ADC转换。得到ADC是否转换完成的信息的方法有两种方法：1. 查询法：查询寄存器A
使用ADC只需要对相应的寄存器进行配置，然后启动ADC即可，启动ADC有两种方法：本文引用地址: 1. 手动完成启动。2.读取上一次转换结果后自动启动下一次ADC转换。得到ADC是否转换完成的信息的方法有两种方法：1. 查询法：查询寄存器ADCCON的第15位（ADC的转换完成位）。2. 中断法：转换完成后，产生ADC中断信号。当不使用触摸屏时，与ADC相关的寄存器主要有据寄存器ADCCON和寄存器ADCDAT0。寄存器ADCCON主要用于选择ADC的启动方式、设置ADC转换时钟以及ADC转换结束标志位等。寄存器ADCDAT0中存放了ADC抓换所得的结果，ADC转换结束后，可以直接读改寄存器的值来得到转换结果。注意：普通ADC转换数据值存储在ADCDAT0的低10位，数据范围0~0x3ff。ADC的时钟来自PCLK时钟的分频，并且时钟必须小于PCLK/5。//****************ADC 中断*****************void ADC_start();extern int ADC_void __irq ADC_isr(){unsigned long irqOffSsend_dat(ADC_dat);send_str((unsigned char *)"ADC is started!\r\n");ADC_dat = 1010;//((int)rADCDAT0&0x3ff);//读取ADC的转换值//dely(100);send_dat(ADC_dat);//ADC_start();//启动ADsend_dat(ADC_dat);irqOffSet = rINTOFFSET;// 取得中断号rSUBSRCPND |= (1<<10)|(1<<9);rSRCPND |= 1<<irqOffSrINTPND= rINTPND;//中断标志清零dely(550);send_str((unsigned char *)"ADC is end!\r\n");}void Init_ADC(){//寄存器进行清零rADCCON &= ~((1<<14)|(0xff<<6)|(0x07<<3)|(1<<2)|(1<<1)|(1<<0));//允许分频，预分频值为49，通道0，正常工作模式，读数时不启动转换rADCCON |= (1<<14)|(49<<6)|(0<<3)|(0<<2)|(0<<1);rINTSUBMSK &= ~((1<<10)|(1<<9));rINTMSK &= ~(1<<31);//使能ADC中断pISR_ADC = (unsigned int)ADC_send_str((unsigned char *)"ADC initial is OK!\r\n");}void ADC_start(){rADCCON |= 0x01;//启动AD转换while(!(rADCCON&0x01));//ADC 开始后，bit0会自动清零}int get_ADC_data(void){//send_dat(ADC_dat);send_str((unsigned char *)"test is started!\r\n");ADC_dat = 1010;//((int)rADCDAT0&0x3ff);//读取ADC的转换值//dely(100);send_dat(ADC_dat);//ADC_start();//启动ADsend_dat(ADC_dat);send_str((unsigned char *)"test is end!\r\n");return 0;}
北京时间6月20日早间消息，美国娱乐软件协会(ESA)就世界卫生组织将&游戏成瘾&列入精神疾病的做法提出激烈批评，认为他们列举的证据不够充分，而且可能引发误诊。ESA呼吁世界卫生组织在将游戏成瘾正式列入......关键字：
北京时间10日讯，在科技股特别是芯片股涨得如火如荼的时候，摩根士丹利却泼了一盆冷水，将美国芯片设备行业股票评级从&与大盘同步&下调为&谨慎&。这是该行业的有史以来最低级别的评级，而这......关键字：
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