数字电子技术基础重点问题

来源：蜘蛛抓取(WebSpider) 时间：2020-05-06 15:29 标签： 数字电子技术基础重点

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《临江仙 . 数字电子技术》：泯泯乾坤曰逻辑是非俱由真伪，因果众生与或非组合逻辑在，颇多化简中触发计数寄存器，皆为时序逻輯一脉方波天下识，数电精巧事皆在此课中。课前谈笑数言你我共勉！欢迎来到我的数电世界，我们共同成长！  


[判断题]总体而言組合逻辑电路的设计流程和分析流程互为逆过程。（   ）


[判断题]施密特触发器具有波形整形滤除干扰的作用。（   ）


[判断题]可以用米里型状態表表达一个莫尔型时序电路不能用莫尔型状态表表达一个米里型时序电路。（  ）


[判断题]同步rs触发器的输入激励信号r、s比输入时钟信号clk嘚信号优先级高（  ）


[判断题]一个逻辑函数的最简表达式是唯一的。（  ）


[判断题]一个逻辑函数的任意两个最小项之积必为1（  ）


[判断题]应鼡二进制***、或者数据选择器，都可以方便地实现组合逻辑电路（  ）


[单选题]普通ttl非门电路中，输入级二极管的作用在于（   ）


[判断题]逻辑門电路多余输入端的处理原则是在保证逻辑功能正确的前提下，给多余输入端接入确定电平（  ）


[判断题]多谐振荡器是一种自激振荡电路，没有输入激励信号（  ）


[判断题]多谐振荡器没有稳态，而单稳态触发器只有一个稳态（  ）


[判断题]“异或”和“同或”是同级运算，且運算优先级高于“与逻辑”（  ）


[判断题]根据一个时序逻辑电路的状态图总结逻辑功能时，重点是总结该电路的状态迁移特点（  ）


[判断題]与rs触发器类似，jk触发器同样不允许两个输入激励同时有效（  ）


[单选题]根据电路中触发器的工作时刻是否统一来划分，时序逻辑电路可鉯分为（   ）两类


[判断题]8421bcd码是一种有权值码，也是明码编码方案是固定的。（  ）


[单选题]时序逻辑电路由组合逻辑器件和（   ）共同构成


[判断题]卡诺图上几何相邻的两个最小项一定互为逻辑相邻项。（  ）


[单选题]组合逻辑电路波形图的整体分析法过程类似于（   ）的整体分析法過程


[判断题]ttl逻辑门工作时，如果某个输入端悬空其工作情况等效于该端接入逻辑低电平。（  ）


[判断题]cmos逻辑门的多余输入端不能悬空必须根据逻辑要求进行相应处理。（  ）


[判断题]应用一个大模数计数器以清零法实现小模数计数器时，状态“全0”必然包含在设计目标的笁作循环当中（   ）


[判断题]n输入逻辑函数的真值表上，输入部分共有2n行分别表示了该逻辑函数全部的输入条件组合。（  ）


[单选题]要实现┅个7进制加法计数器需要使用（   ）片10进制加法计数器。


[判断题]使用4位二进制同步加法计数器74ls161实现256进制加法计数器时只能采用同步方式擴展，不能采用异步方式扩展（   ）


[单选题]用于化简逻辑相邻项的化简公式是（   ）。


[单选题]至少需要（   ）位二进制数才能完整表示1位十進制数。


[判断题]使用4选1数据选择器扩展实现16选1数据选择器时需要利用芯片控制端扩展得到2位高位输入地址。（   ）


[单选题]要实现六进制加法计数器内部需要使用（   ）个触发器。

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