74ls192为什么查的74ls161引脚图及功能跟我们学的74ls161引脚图及功能不一样啊??求大神帮忙讲解一下怎么设计68进制计数器!!

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数字电子技术基础课程设计
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你可能喜欢数字模拟电路的问题,我刚学这门学科,想要用74ls47、74ls191或74ls192、4017、7段数码管做一个60进制的。_百度知道
数字模拟电路的问题,我刚学这门学科,想要用74ls47、74ls191或74ls192、4017、7段数码管做一个60进制的。
hiphotos.baidu://a://a.jpg" target="_blank" title="点击查看大图" class="ikqb_img_alink"><img class="ikqb_img" src="http,如何设计./zhidao/wh%3D450%2C600/sign=/zhidao/wh%3D600%2C800/sign=1a4aece5fb5/c83d70cf3bc79f3d60b0f8e5baa1cd?请帮忙画一下图。另外想要知道这些元器件的引脚符号的作用。万分感谢<a href="http.jpg" esrc="http,什么CLK.hiphotos、TCD之类的.com/zhidao/pic/item/c83d70cf3bc79f3d60b0f8e5baa1cd.hiphotos.baidu://a想要做一个60进制的计数器
提问者采纳
TCD应该是触发信号端(具体是什么,我也画不出来了,自己去书找如何画吧,既然知道用这些芯片来设计电路自然可以查到引脚定义,你可以去查查芯片组的引脚定义,转化成数学式画卡诺图,忘了)。既然在学。CLK是时钟信号,由数学式接线
提问者评价
原来是这样,感谢!
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出门在外也不愁74LS192引脚图管脚及功能表-功率放大电路图-电子产品世界
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74LS192引脚图管脚及功能表
74LS192是同步十进制可逆计数器,它具有双时钟输入,并具有清除和置数等功能,其引脚排列及逻辑符号如下所示:图5-4 74LS192的引脚排列及逻辑符号 (a)引脚排列 (b) 逻辑符号图中:为置数端,为加计数端,为减计数端,为非同步进位输出端,为非同步借位输出端,P0、P1、P2、P3为计数器输入端,为清除端,Q0、Q1、Q2、Q3为数据输出端。其功能表如下: 输入 输出MRP3P2P1P0Q3Q2Q1Q01&&&&&&&000000&&dcbadcba
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