10款最值得推荐的桌面处理器2016 - 评测专区
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l5420这CPU怎么样
L5420这CPU怎么样能用在775主板上
大神们说说这U性能相当现在的什么U& &还有用过这U撸友晒一下配置
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自己看 不解释
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771的至强 相当于同频率的Q9
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引用:原帖由 gin250 于
16:31 发表 &&s0 F: ~0 h* F0 C7 d
771的至强 相当于同频率的Q9 3 M5 C7 c5 t1 E0 |' O2 W
这U要用什么显卡~~~跟I3有得比吗？
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没用过!我也是听说性能很好!
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这玩意配啥显卡&&没啥要求。。。
如果是同频 除了部分项目（基本上是内存跑分） 决不输给955/965一类的K10的
龟壳花蛇 狗尾巴花 我帅吗 ...
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显卡还是根据个人爱好上 U绝大游戏是没有问题的 看你玩什么游戏需求就上什么显卡！ U很便宜很强大 跟X4 955媲美了吧 。
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如果和I3比&&还真的不太好比较&&
2 j&&\0 P8 X3 ?) A' J+ V% m3 B2 ]
多核心性能 理论上甚至可能会超过I3/ b6 L" V9 }) p+ I! V- o1 R0 S+ f
% F6 A- D' H$ _: i* |; J, {
&&但是单核心性能会比I3略低（以上是建立在同频率的基础上）
- A2 \9 h* k4 z, n/ x
内存性能。。。被I3完虐。。。" Y! d9 ]! x0 o8 S
PS： 771和775平台一样 内存控制器在主板北桥 而不是CPU内部 性能受到FSB的严重**
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没有一个撸友用过这U吗？有的把单发上看看( w: o+ x7 K! E" Z7 v5 R( X2 J$ s
8 T6 o# e9 o& _' n
个人就是看这U怎么就那么便宜性能都说好？？？？
# x( M3 ]/ i0 a( ]# S0 E: [" f8 F" e
这U还能顶个一年半载吗？6 ~2 J: ?8 D5 ~& B/ U
[ 本帖最后由
03:07 编辑 ]
龟壳花蛇 狗尾巴花 我帅吗 ...
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自己看 我的帖子 我就在用
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龟壳花蛇 狗尾巴花 我帅吗 ...
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回复 7楼 gin250 的帖子
反正我个人认为 所谓的单核性能 跟内存性能 一般人玩都感觉不出来 除了跑分 基本没有感觉的到 对比这个没有意思 就不是一个时代的东西 而且价格差距非常大 我宁愿选择前者 实惠 性能强大 便宜&&但是多任务处理多核压力测试下L5420完爆I3双核 唯一的悲剧就是主频低。。。你要是有钱就上L5520 四核八线程&&小超一下&&国际象棋能跑到1.3万分 听说是媲美I5系列了
& g6 Q&&Y* ?" R/ F8 Q/ |9 W2 i/ D7 y
[ 本帖最后由 kid8436212 于
09:03 编辑 ]
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我上了两颗L5440和L5462，跑分都和I3差不多，渲染没话说
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回复 11楼 kid8436212 的帖子
在很多多核心优化不够完善的程序下&&单核心性能还是有很重要意义的
' K4 y' p2 g8 z0 Z6 d$ P" s
如果不在乎单核心性能 AMD的推土机也就不会有性能羸弱的评价了
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回复 11楼 kid8436212 的帖子
L5520.。。。2 G8 K* _' B9 E7 f
主板好贵。。。
龟壳花蛇 狗尾巴花 我帅吗 ...
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回复 14楼 gin250 的帖子
那你还上AMD 的X4 640。。U。。玩着AMD 说英特尔的好
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请问AMD A4-5000 这一款CPU怎么样，有人说比g1620好
如题，这个人是在骗我吗？
A4-5000好像是笔记本的吧 性能肯定不如G1620 AMD的 最少也要A8起步吧
是是是是是是是是是是是是是是是是
A4-5000好像是笔记本的吧 性能肯定不如G1620 AMD的 最少也要A8起步吧
prodesk 405 g1这一款台式机就有
是是是是是是是是是是是是是是是是
我是在问一台台式机的时候得知的，prodesk 405 g1
我是在问一台台式机的时候得知的，prodesk 405 g1
别买&&给也不要
A4-5000这种低功耗的APU还是洗洗睡吧
A4-5000这种低功耗的APU还是洗洗睡吧
人家是对付atom用的
本帖最后由 yybird81 于
08:17 编辑
人家是对付atom用的
楼主说“有人说比g1620好”
这人估计就是卖电脑的
prodesk 405 g1这一款台式机就有
这是商务机 这款CPU用于平时办公当然够用了 不过要是家用 还是不推荐 要嘛G1620要嘛A8 5600K
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显卡吧的基佬作品
（MIPS32架构，超纯量双数据路径，五级流水线）链接
本科生课程设计中的一流水平，大一能做到这样相当相当棒了。
能写出来就不错了，大一就做这事肯定是对计算机架构很感兴趣，值得鼓励！接下来还有很多步骤，比如功能验证，后端综合布局布线，时序分析，等等架构层面的设计在写之前还有很多步骤，主要是经验丰富的老工程师在大方向上把关，然后各种小兵做架构级别的仿真，等等有这样的人才，祖国芯片产业一定会蒸蒸日上
同意楼上观点，大一能理解CPU架构已经是预习过了，能理解流水线，参考改编已有设计并且把schematic图画出来实属不易。楼主居然还出了synthesis。单论CPU架构理解和处理器设计水平已经比我当年大二结束好了，应该可以和当年学校里那几个去Altera实习的货比试一下。比较基准：全球电子工程top15学校的学渣，也就是我。
「看完发现我大学白上了」系列
只想说大一这个程度，让我这个搞体系结构phd，现在美一top半导体芯片厂商工作的渣渣感到羞愧。我大一的时候还不知道什么叫做体系结构呢，verilog也没听说过。此小朋友有前途。
本人大二，已经写过一个类似的10指令五级流水MIPS 32处理器。正在写扩充成50条指令的版本。老师说本科生能独立完成这个，水平相当于可以与世界一流大学的本科生一较高下。题主大一就做出这个相当不容易了。赞一发！【电路其实没必要手画，学学Logisim，简单易上手。（其实明白原理之后就可以不看电路直接上代码了）】
大二上学期数字系统设计课程也学过这个，课程大作业是用 Verilog 写MIPS架构的五级流水线CPU。自己定义CPU的指令集，用汇编指令仿真，检验运行结果。为了理解起来更容易，当时自定义的指令集是16位的，因此当时做的并不是标准的32位MIPS处理器。当时的课本也是，按照老师给的数据流程图和一部分提示代码完成的。大二下学期的低功耗电路设计课程再次回顾了基本的设计，尝试使用 Parsing 和 Clock Gating 的方法降低CPU的功耗。当时的课本是，但基本没怎么用到课本。大二下学期的计算机组成原理课再次学了processor design，老师以32位的MIPS处理器为例讲解得很详细，对各个组成部分的 data path 和 control path 理解得更深入了，同时也加深了对 data hazard 和 control hazard 的理解。课本是，课程大作业是补充 arm 处理器的 Instruction Cache 和 Data Cache，反汇编随机数排序程序，加载到仿真程序，检验设计是否正确。学了这么多，但其实仍旧没有透彻的理解和记住。因为忙于其他的课程，很久没有再看，很多细节如果不重新复习甚至已经忘记了。如果不参考课本、老师讲解的PPT、额外的资料，完全依靠自己思考、绘图、写代码，应该是完成不了的。所以我觉得如果在没有老师指导的情况下大一完成，是挺厉害的。感谢传道授业解惑的老师们。
大一对于设计CPU感兴趣，有前途。看楼上很多回答很惊讶大一就会Verilog，不知是不是因为国内大一还没怎么开始学专业课。在NTU的话，所有CS和CE的学生大一上学期就会接触Verilog，然后后续课程也有MIPS CPU的设计。我之前大一的时候为了准备一个workshop拿logisim做过一个非常简单的CPU，然后大二一门课的project实现了一个16位MIPS的CPU，带5级pipeline，data forwarding，early branch decision，自动stall pipeline解决dependency等等。不过后来交了作业就没再改进过了。代码在这
额，我也来简单评价下，毕竟上个学期刚做了MIPS芯片的设计实验，趁着脑子里的东西还没忘空，赶快来讲一讲。如果这位是为了完成FPGA设计的话，无疑他完成的非常优秀。大学一年级能完成这份工作，如果没有旁人的帮助的话，他的毅力与执行力这的称道。简单说来，芯片设计是工程学。他对理论设计的能力要求，没有想象中的那么高。如果不是要真的流片，把芯片实际做出来，就更简单了。如果大家小的时候玩过乐高、电子积木、甚至是安装四驱车，大家应该对拼东西这个概念都有理解。芯片设计其实和这个差不多，大家把需要的部分摆在桌子上，写一写连线，在ISE软件里面跑一下仿真，烧到FPGA板子里看一下结果，（对于我）就可以把实验报告交上去了。（当然也是因为我是个学渣，比较弱）如果对于芯片设计有兴趣的话，我很高兴于能为大家介绍几位浙江大学的老师的个人主页，大家如果有时间可以来看看。刘鹏副教授韩雁教授——————————————————分割线下面可以不看————————————————这里有两个问题，一个是硬件，另一个也是硬件。首先是硬件，芯片的设计，如果是一个硕士、博士级别的工作的话，是要考虑流片的。我之前提到过，芯片设计是工程学。既然是工程学，就要考虑成本，考虑工艺误差（或者用我刚学到的词：工艺角）。成本很好理解，芯片面积越大，成本越高，所以芯片里部件所占的面积比应该尽可能的高（百分之八十）。工艺角则是考虑温度变化以及芯片生产的时候每一个部件可能出现的误差，从nMOS和pMOS的电流误差考虑芯片性能，有很多学长辛辛苦苦做出来的芯片就是因为在某种情况下，芯片功能失效，不得不重(延)做(毕)。但这里毕竟只是跑了系统仿真，连芯片的仿真都没有做，就差的比较多了。第二个问题，这位设计的时候，其实可以理解成炫技，设计一个双核的CPU。两套数据总线两套地址总线，用一个简单的分支预测来决定数据通往哪一个核心。这里我可以很果断的作出判断，这个双核，性能非常的非常的差。如果大家对此不以为然的话，回想一下奔腾4的胶水双核，想一下性能，想一下耗能，想一下发热。如果说单核CPU的设计核心还在于加法器、寄存器、总线等等的设计，多核CPU则是完全不同的重点了。简单讲，我可以用一个小程序让这个CPU发疯。1000 addi $1,$1,11004 j 1000根据这个分发策略，(我没有看到这位设计解决Data Harzard的方法)，会发生两种情况：一个核心被完全忘记，这种情况是比较好的；两个核心分别完成加法，互相等待对方完成计算。这种情况甚至不如做过转发的单核心CPU。这个CPU想完成并行运算，但并没有对并行进行优化。如果说这位想向CPU设计更进一步的话，我个人有两点建议：第一点，放弃哈佛结构，开始读一些Intel的芯片设计的书。哈佛结构固然结构简单性能优秀，但是在面对通用领域的时候，性能最高有百分之五十的浪费，这是非常不合理的。普林斯顿结构（或者称为冯诺依曼结构）固然复杂，却是非常有用的，实际上我们用的大部分CPU，都是普林斯顿结构。（再次吐槽13级流水是人能设计的吗，Intel你是外星人办的企业吧）第二点，芯片设计领域非常的复杂，建议学一些半导体物理、芯片设计、超大规模集成电路设计、DSP应用等方面的课程，以让自己面对更多的问题都能游刃有余。顺便一提DSP芯片都是并行，这位可以多看看。
我大三时写过一个8-bit RISC CPU，自定义的指令集，单指令单周期。最大的特点是支持硬件多线程（总要有点亮点）。拉了室友移植了binutils使其支持汇编到二进制。外设包括PS2, VGA, GPIO。demo运行在FPGA上，用汇编实现的。包括一个在显示器上的简易terminal用来做简单的运算以及显示存在flash的位图，还可以控制灯。项目的名字叫“MTM多线程处理器”，我设计了LOGO，还有完整的ISA手册。当时参加了OpenHW开源硬件大赛，所有东西都开源了，。凭着做这个项目的积累，我一个计算机专业的学生毕业找到了Digital IC工程师的工作。不过您可真的别当真，现在回过来看来那时的项目那才叫一个图样图森破+拿衣服.....
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