单片机IO口的上下拉电阻问题总结
上下拉电阻的问题，必须与IO口具体的内部结构相结合，才能分析清楚。
以下分析传统51单片机和AVR单片机的IO口。
以下只分析P0和P1，其他类同。
1.P0位结构图如下：
当P0作为通用IO口使用时，上面的场效应管会截止，可以理解成上边的电路断路，剩下电路仅为一开漏极电路。
输入时：引脚上的信号直接通过读引脚的缓冲器被读入；
输出时：由于上边的电路近似断路，剩下的电路为开漏极，所以需要加上上拉电阻才能输出高电平；
2.P1位结构图如下：
输入时：由于已带上拉电阻，所以需先将场效应管截止，即置1，才能正确读入；
输出时：由于已带上拉电阻，所以无需再加上拉电阻；
注：有时自带的上拉的电阻为弱上拉电阻（阻值很大，使得IO口的驱动电流不够），所以可以再外接强上拉电阻。
IO口等效原理图如下：
输入时：直接读入；
输出时：可自行配置是否使用内部上下拉电阻；
1.输入时，与上拉电阻关系不大；输出时，要根据需要选择使用自带或外部的上拉电阻。下图可帮助理解：
2.输出时，要考虑到输出高低电平时，IO口自身的拉出电流和灌入电流的大小限制，是否满足驱动外电路。
3.以上分析仅为帮助理解。
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max485 到底是A接上拉电阻，B下拉电阻还是A下拉，B上拉？
a上拉&&b下拉
回复【1楼】AWEN2000
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回复【楼主位】embeddev
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2楼呢？3楼正解。
a上拉接+5V，b下拉接地
linxc6588650 发表于
a上拉接+5V，b下拉接地
不知道能不能说一下为什么呢？A\B不是对等的吗？
楼上全部正解
不知道怎么拉不如不拉。
楼上匀正解。
hulx 发表于
不知道怎么拉不如不拉。
这个是有经验的正解.
一般上拉，下拉电阻多大？
应用的时候，不用外加上下拉电阻的，A与B之间要加一个电阻
应用的时候，不用外加上下拉电阻的，A与B之间要加一个电阻
A和B之间串联的电阻一般推荐多大的，上下拉电阻又多大，有没有必要加TVS保护？
A和B之间串联的电阻一般推荐多大的，上下拉电阻又多大，有没有必要加TVS保护？ ...
我们是这样做的，A与B之间串一个100R的电阻
我们是这样做的，A与B之间串一个100R的电阻
嗯，应用场所怎样，没加TVS吗
上拉&&下拉 一般都是1K的电阻吧?
上拉到多少伏是以芯片的门限电压决定的，去查spec。
上拉下拉电阻是以你的带载能力来决定的，如果需要带多路485设备，这个电阻可以往小选取，如果只是单点对接，可以考虑加大。经验值一般在2K到4.7K间选择。
中间串接电阻是电压钳位的，A,B线的有效压差为200mV，所以钳位电压需要在200mV内，防止在无数据时候的电压波动导致误动作，所以自己算吧，一般都是几百欧姆的。
我们公司一般是3.3k，而且成熟使用超过20年！
上拉电阻的作用主要是为了 芯片空闲的时候 AB间电压在 200mv以上确保接收器为逻辑1&&因此可根据芯片参数和子站数量（并联了）选型；
西门子PLC-485总线AB间如是终端则并接120欧，A上拉3.9K，B下拉3.9K。
阿莫电子论坛, 原"中国电子开发网"【电子基础复习】-上拉下拉电阻、I/O输出（开漏、推挽等） - 简书
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【电子基础复习】-上拉下拉电阻、I/O输出（开漏、推挽等）
第一部分：上拉电阻&下拉电阻
文章摘自：/content/16/998.shtml是不是经常听别人讲，加个上拉电阻试试看，加个下拉电阻试试看，是不是还在疑惑上下拉电阻是什么，该怎么用，什么时候用，有什么用途？1.什么是上下拉电阻上拉电阻：把一个不确定的信号通过电阻连接到高电平，使该信号初始为高电平；下拉电阻：把一个不确定的信号通过电阻连接到低电平，使该信号初始为低电平；2.上下拉电阻的接线方法上拉电阻如下图所示：
上拉电阻示例
电阻R12将KEY1网络标识上拉到高电平，在按键S2没有按下的情况下KEY1将被钳制在高电平，从而避免了引脚悬空而引起的误动作；下拉电阻如下图所示：
下拉电阻示例
电阻R29将DIR网络标识下拉到低电平，在光耦没有导通的情况下DIR将被钳制在低电平，从而避免了引脚悬空而引起的误动作；3.上下拉电阻的作用提高电路稳定性，避免引起误动作。第一图中的按键如果不通过电阻上拉到高电平，那么在上电瞬间可能就发生误动作，因为在上电瞬间单片机的引脚电平是不确定的，上拉电阻R12的存在保证了其引脚处于高电平状态，而不会发生误动作。提高输出管脚的带载能力。受其他外围电路的影响单片机在输出高电平时能力不足，达不到VCC状态，这会影响整个系统的正常工作，上拉电阻的存在就可以使管脚的驱动能力增强。这里特别强调如下：带片上I2C资源的单片机，其SCL和SDA引脚是开漏引脚，如果当做普通的GPIO来用的话，你会发现该引脚输出高电平极不稳定甚至因为负载的关系都无法正常输出高电平，这时候就需要在这两个引脚上加上拉电阻了。第二部分：开漏输出、推挽输出文章转载整理自自知乎的回答：/question//answer/1、一些三极管基础要理解推挽输出，首先要理解好三极管（晶体管）的原理。下面这种三极管有三个端口，分别是基极（Base）、集电极（Collector）和发射极（Emitter）。下图是NPN型晶体管。
NPN型晶体管-1
这种三极管是电流控制型元器件，注意关键词电流控制。意思就是说，只要基极B有输入（或输出）电流就可以对这个晶体管进行控制了。下面请允许我换一下概念，把基极B视为控制端，集电极C视为输入端，发射极E视为输出端。这里输入输出是指电流流动的方向。
NPN型晶体管-2
当控制端有电流输入的时候，就会有电流从输入端进入并从输出端流出。
NPN型晶体管电流流动
而PNP管正好相反，当有电流从控制端流出时，就会有电流从输入端流到输出端。
PNP型晶体管
2、开漏输出电路要理解开漏，可以先理解开集。
如图，开集的意思，就是集电极C一端什么都不接，直接作为输出端口。如果要用这种电路带一个负载，比如一个LED，必须接一个上拉电阻，就像下图这样。
开集电路-带负载
当Vin没有电流，Q5断开时，LED亮。当Vin流入电流，Q5导通时，LED灭。开漏电路，就是把上图中的三极管换成场效应管（MOSFET）。这样集电极就变成了漏极，OC就变成了OD，原理分析是一样的。N型场效应管各个端口的名称：
场效应管是电压控制型元器件，只要对栅极施加电压，DS就会导通。结型场效应管有一个特性就是它的输入阻抗非常大，这意味着：没有电流从控制电路流出，也没有电流进入控制电路。没有电流流入或流出，就不会烧坏控制电路。而双极型晶体管不同，是电流控制性元器件，如果使用开集电路，可能会烧坏控制电路。这大概就是我们总是听到开漏电路而很少听到开集电路的原因吧？因为开集电路被淘汰了。++++++++++伟大的分割线+++++++++我们再来看一个典型的集电极开路电路：
集电极开路示例
右边的那个三极管集电极什么都不接，所以叫做集电极开路（左边的三极管为反相之用，使输入为“0”时，输出也为“0”）。对于图1，当左端的输入为“0”时，前面的三极管截止（即集电极C跟发射极E之间相当于断开），所以5V电源通过1K电阻加到右边的三极管上，右边的三极管导通（即相当于一个开关闭合），此时输出端与地相接，电压为“0”；当左端的输入为“1”时，前面的三极管导通，此时后面的三极管输入端电压被接地，电压拉低，三极管截止了（相当于开关断开）。我们将图1简化成图2的样子。图2中的开关受软件控制，“1”时断开，“0”时闭合。很明显可以看出，当开关闭合时，输出直接接地，所以输出电平为0。而当开关断开时，则输出端悬空了，即高阻态。这时电平状态未知，如果后面接一个电阻负载（即使很轻的负载）到地，那么输出端的电平就被这个负载拉到低电平了，所以这个电路是不能输出高电平的。开漏电路就是指以MOSFET的漏极为输出的电路。一般的用法是会在漏极外部的电路添加上拉电阻。完整的开漏电路应该由开漏器件和开漏上拉电阻组成。如下图2-1所示：
图2-1 开漏电路示例
组成开漏形式的电路有以下几个特点：1） 利用外部电路的驱动能力，减少IC内部的驱动（或驱动比芯片电源电压高的负载）。当IC内部MOSFET导通时，驱动电流是从外部的VCC流经R pull-up ，MOSFET到GND。IC内部仅需很下的栅极驱动电流。如图2-1。2） 可以将多个开漏输出的Pin，连接到一条线上。形成 “与逻辑” 关系。如图2-1，当PIN_A、PIN_B、PIN_C任意一个变低后，开漏线上的逻辑就为0了。这也是I2C，SMBus等总线判断总线占用状态的原理。如果作为输出必须接上拉电阻。接容性负载时，下降延是芯片内的晶体管，是有源驱动，速度较快；上升延是无源的外接电阻，速度慢。如果要求速度高电阻选择要小，功耗会大。所以负载电阻的选择要兼顾功耗和速度。3） 可以利用改变上拉电源的电压，改变传输电平。如图2-2, IC的逻辑电平由电源Vcc1决定，而输出高电平则由Vcc2（上拉电阻的电源电压）决定。这样我们就可以用低电平逻辑控制输出高电平逻辑了（这样你就可以进行任意电平的转换）。（例如加上上拉电阻就可以提供TTL/CMOS电平输出等。）
4） 开漏Pin不连接外部的上拉电阻，则只能输出低电平(因此对于经典的51单片机的P0口而言，要想做输入输出功能必须加外部上拉电阻，否则无法输出高电平逻辑)。一般来说，开漏是用来连接不同电平的器件，匹配电平用的。5） 标准的开漏脚一般只有输出的能力。添加其它的判断电路，才能具备双向输入、输出的能力。6） 正常的CMOS输出级是上、下两个管子，把上面的管子去掉就是OPEN-DRAIN了。这种输出的主要目的有两个：电平转换、线与。7） 线与功能主要用于有多个电路对同一信号进行拉低操作的场合，如果本电路不想拉低，就输出高电平，因为OPEN-DRAIN上面的管子被拿掉，高电平是靠外接的上拉电阻实现的。（而正常的CMOS输出级，如果出现一个输出为高另外一个为低时，等于电源短路。）8） OPEN-DRAIN提供了灵活的输出方式，但是也有其弱点，就是带来上升沿的延时。因为上升沿是通过外接上拉无源电阻对负载充电，所以当电阻选择小时延时就小，但功耗大；反之延时大功耗小。所以如果对延时有要求，则建议用下降沿输出。应用中需注意：1） 开漏和开集的原理类似，在许多应用中我们利用开集电路代替开漏电路。例如，某输入Pin要求由开漏电路驱动。则我们常见的驱动方式是利用一个三极管组成开集电路来驱动它，即方便又节省成本。如图2-3。
2） 上拉电阻R pull-up的阻值决定了逻辑电平转换的沿的速度。阻值越大，速度越低功耗越小。反之亦然。3、推挽输出电路来看一个典型的推挽输出电路：
推挽输出电路
上面的三极管是N型三极管，下面的三极管是P型三极管，请留意控制端、输入端和输出端。当Vin电压为V+时，上面的N型三极管控制端有电流输入，Q3导通，于是电流从上往下通过，提供电流给负载。
推挽输出电路-推电流
经过上面的N型三极管提供电流给负载（Rload），这就叫「推」。当Vin电压为V-时，下面的三极管有电流流出，Q4导通，有电流从上往下流过。
推挽输出电路-挽电流
经过下面的P型三极管提供电流给负载（Rload），这就叫「挽」。以上，这就是推挽（push-pull）电路。4、一些总结1） 推挽输出能够输出高或者低，而开漏输出只能输出低，或者关闭输出，因此开漏输出总是要配一个上拉电阻使用。2） 开漏输出的上拉电阻不能太小，太小的话，当开漏输出的下管导通时，电源到地的电压在电阻上会造成很大的功耗，因此这个电阻阻值通常在10k以上，这样开漏输出在从输出低电平切换到高电平时，速度是很慢的。3） 推挽输出任意时刻的输出要么是高，要么是低，所以不能将多个输出短接，而开漏输出可以将多个输出短接，共用一个上拉，此时这些开漏输出的驱动其实是与非的关系。4） 推挽输出输出高时，其电压等于推挽电路的电源，通常为一个定值，而开漏输出的高取决于上拉电阻接的电压，不取决于前级电压，所以经常用来做电平转换，用低电压逻辑驱动高电压逻辑，比如3.3v带5v。
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请教原子哥stm32开发ov7670的sccb接口是不是必须接上拉电阻？我看你的板子原理图好像没有接上拉电阻a
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问题如题，希望原子哥百忙中解答一下真是谢谢你了
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不是必须的。
我们用内部上拉，工作的很好。
我是开源电子网站长，有关站务问题请与我联系。
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回复【2楼】正点原子:
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那两个接口不是应该设置为输出吗？输出上拉和下拉不是被禁止的吗？具体应该怎么样设置，希望指点一二，谢谢了啊
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回复【3楼】zhao:
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和IIC一样，有输入的情况，读SCCB数据的时候。
我是开源电子网站长，有关站务问题请与我联系。
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上拉电阻与下拉电阻怎么接线？上拉电阻和下拉电阻有什么用？
TA的每日心情奋斗 20:23签到天数: 40 天[LV.5]常住居民I
上拉电阻与下拉电阻用在数字电路中，存在高低电平的场合。
　　上拉电阻与下拉电阻怎么接线？
　　上拉电阻：电阻一端接VCC，一端接逻辑电平接入引脚(如引脚)
　　下拉电阻：电阻一端接GND，一端接逻辑电平接入引脚(如单片机引脚)
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　　如上图，R13和R14，一端接到了3.3V，一端通过J17连接到单片机引脚，这两个电阻就是上拉电阻。
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09:35 上传
　　如上图，R18的一端连接到了GND，一端连接到了单片机的引脚(只不过是串了一个电阻后连接到了单片机引脚)。所以这个就是下拉电阻。
　　上拉电阻和下拉电阻有什么用？
　　提高驱动能力：
　　例如，用单片机输出高电平，但由于后续电路的影响，输出的高电平不高，就是达不到VCC，影响电路工作。所以要接上拉电阻。下拉电阻情况相反，让单片机引脚输出低电平，结果由于后续电路影响输出的低电平达不到GND，所以接个下拉电阻。
　　在单片机引脚电平不定的时候，让后面有一个稳定的电平：
　　例如上面接下拉电阻的情况下，在单片机刚上电的时候，电平是不定的，还有就是如果你连接的单片机在上电以后，单片机引脚是输入引脚而不是输出引脚，那这时候的单片机电平也是不定的，R18的作用就是如果前面的单片机引脚电平不定的话，强制让电平保持在低电平。
　　再这么解释一下吧，如果IE_DATA那个地方，不连接任何引脚，那么由于R18的下拉作用，IE_DATA就是低电平，所以就不会导通。
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